产品描述
面向 FPGA GTH 收发器的 LogiCORE™ ChipScope™ Pro 集成式误码率测试器 (IBERT) 内核是一个可定制的内核，可用于评估和监控 Virtex-6 GTH 收发器的运行状况。该设计包括采用 FPGA 逻辑实现的模式生成器和检查器，并能够接入 串行收发器 的端口和 DRP 端口。还包括了通信逻辑，可通过 JTAG 在运行时间进行设计访问。IBERT 内核是一个独立设计，其生成过程贯穿了整个实现流程（包括生成比特流）。
主要特性与优势
- 为 ChipScope Pro 分析器软件与 IBERT 内核之间提供了通信路径。
- 用户可选 Virtex-6 FPGA GTH 收发器数量.
- 可根据所需的线速、参考时钟速率、参考时钟源以及数据通路宽度来定制每个收发器。
- 需要源自引脚的系统时钟。
技术支持
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